高效实时的抽取滤波器的FPGA实现

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高效实时的抽取滤波器的FPGA实现

陈俊, 汪学刚

文章导航 > 电子科技大学学报 > 2005 > 34(6): 755-758

陈俊, 汪学刚. 高效实时的抽取滤波器的FPGA实现[J]. 电子科技大学学报, 2005, 34(6): 755-758.

引用本文:

陈俊, 汪学刚. 高效实时的抽取滤波器的FPGA实现[J]. 电子科技大学学报, 2005, 34(6): 755-758.

CHEN Jun, WANG Xue-gang. High Efficient and Real-Time Realization of Decimation Filter Based on FPGA[J]. Journal of University of Electronic Science and Technology of China, 2005, 34(6): 755-758.

Citation:

CHEN Jun, WANG Xue-gang. High Efficient and Real-Time Realization of Decimation Filter Based on FPGA[J]. Journal of University of Electronic Science and Technology of China, 2005, 34(6): 755-758.

高效实时的抽取滤波器的FPGA实现

陈俊,
汪学刚

1.
电子科技大学电子工程学院成都 610054

作者简介:
陈俊(1979-),男,硕士生,主要从事高速实时数字信号处理方面的研究.

中图分类号: TN957.51

High Efficient and Real-Time Realization of Decimation Filter Based on FPGA

1.
School of Electronic Engineering,UEST of China Chengdu 610054

摘要: 介绍了分布式算法实现乘积和运算的原理及工程上的实现方式,提出了适合现场可编程门阵列器件基本查找表结构的改进分布式算法,通过计算机仿真,在具体器件上实现了抽取滤波器。实验结果表明:该分布式算法结构可以充分利用现场可编程门阵列器件的资源,并且只引入固定的流水线延迟,具有很好的高效性和实时性。
- 分布式算法 /
- 现场可编程门阵列 /
- 查找表 /
- 抽取
Abstract: This paper briefly talks about the principle of distributed arithmetic algorithm and its application to the multiply-accumulate before puts forward a improved distributed arithmetic algorithm which suits the look up table structure of filed programmable gate array well. Simulated and tested results on real device shows that high efficient and real-time decimation filter with some invariable pipeline delay can be achieved through this improved algorithm. The fabricated decimation filters are used in real digital receiver.
- distributed arithmetic algorithm /
- filed programmable gate array /
- look up table /
- decimation filter

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[3]	梅林, 张凤荔, 王瑞锦, 高强. 基于网格划分加权的分布式离群点检测算法 . 电子科技大学学报, 2020, 49(6): 860-866. doi: 10.12178/1001-0548.2020202
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[7]	李文昌, 万理, 阮爱武, 宋子健, 于敦山. 应用于不同类型FPGA的多模式调试系统 . 电子科技大学学报, 2014, 43(5): 685-690. doi: 10.3969/j.issn.1001-0548.2014.05.009
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高效实时的抽取滤波器的FPGA实现

陈俊,
汪学刚

1. 电子科技大学电子工程学院成都 610054

作者简介:
陈俊(1979-),男,硕士生,主要从事高速实时数字信号处理方面的研究.

收稿日期: 2003-11-06
刊出日期: 2005-12-15

中图分类号: TN957.51

关键词:

摘要: 介绍了分布式算法实现乘积和运算的原理及工程上的实现方式,提出了适合现场可编程门阵列器件基本查找表结构的改进分布式算法,通过计算机仿真,在具体器件上实现了抽取滤波器。实验结果表明:该分布式算法结构可以充分利用现场可编程门阵列器件的资源,并且只引入固定的流水线延迟,具有很好的高效性和实时性。

English Abstract

陈俊, 汪学刚. 高效实时的抽取滤波器的FPGA实现[J]. 电子科技大学学报, 2005, 34(6): 755-758.

引用本文:

陈俊, 汪学刚. 高效实时的抽取滤波器的FPGA实现[J]. 电子科技大学学报, 2005, 34(6): 755-758.

CHEN Jun, WANG Xue-gang. High Efficient and Real-Time Realization of Decimation Filter Based on FPGA[J]. Journal of University of Electronic Science and Technology of China, 2005, 34(6): 755-758.

Citation:

CHEN Jun, WANG Xue-gang. High Efficient and Real-Time Realization of Decimation Filter Based on FPGA[J]. Journal of University of Electronic Science and Technology of China, 2005, 34(6): 755-758.

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