高性能可重构DSP处理器的数据通路设计

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高性能可重构DSP处理器的数据通路设计

韩亮, 李莺, 张馨, 陈杰

文章导航 > 电子科技大学学报 > 2005 > 34(2): 194-197

韩亮, 李莺, 张馨, 陈杰. 高性能可重构DSP处理器的数据通路设计[J]. 电子科技大学学报, 2005, 34(2): 194-197.

引用本文:

韩亮, 李莺, 张馨, 陈杰. 高性能可重构DSP处理器的数据通路设计[J]. 电子科技大学学报, 2005, 34(2): 194-197.

HAN Liang, LI Ying, ZHANG Xin, CHEN Jie. Data Path Design in High Performance Reconfigurable DSP Processor[J]. Journal of University of Electronic Science and Technology of China, 2005, 34(2): 194-197.

Citation:

HAN Liang, LI Ying, ZHANG Xin, CHEN Jie. Data Path Design in High Performance Reconfigurable DSP Processor[J]. Journal of University of Electronic Science and Technology of China, 2005, 34(2): 194-197.

高性能可重构DSP处理器的数据通路设计

1.
中国科学院微电子研究所北京 100029

作者简介:
韩亮(1979-),男,硕士,助理研究员,主要从事数字信号处理,计算体系结构方面的研究.

中图分类号: TN911

Data Path Design in High Performance Reconfigurable DSP Processor

1.
Institute of Microelectronics of Chinese Academy of Science Beijing 100029

摘要: 介绍了高性能定点可重构DSP处理器的数据通路设计。该数据通路以功能强大的16位定点计算单元为基础,搭建起高速16位数据处理平台;并能以单指令流多数据流的方式灵活支持多维向量运算;通过重构的方法有效地支持了32位数据处理。
- 数字信号处理 /
- 数据通路 /
- 可重构 /
- 单指令流多数据流 /
- 并行处理
Abstract: In this paper, the data path of a high performance reconfigurable DSP processor is introduced. Based on its several 16-bit fixed-point computational units with powerful functions, the data path forms a 16-bit high-speed signal processing platform. By SIMD means, it can flexibly support computations of multi-dimension vector. By the way of reconfiguration, it can efficiently support 32-bit data processing.
- digital signal processing /
- data path /
- reconfigurable /
- single instruction stream over multiple data strams /
- parallel processing

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[2]	王菊, 刘付显, 靳春杰, 李祯东. 一种面向不确定数据流的模体发现算法 . 电子科技大学学报, 2017, 46(1): 81-87. doi: 10.3969/j.issn.1001-0548.2017.01.013
[3]	范阿冬, 秦晓卫, 戴旭初. 基于矢量处理器的可编程并行MIMO检测器设计 . 电子科技大学学报, 2016, 45(3): 337-343. doi: 10.3969/j.issn.1001-0548.2016.02.004
[4]	马上, 汪陈浩, 胡剑浩. 一种余数系统基扩展算法及VLSI实现 . 电子科技大学学报, 2015, 44(2): 205-210. doi: 10.3969/j.issn.1001-0548.2015.02.008
[5]	尹德强, 邓兵, 王旭. 基于Pei采样型DFRFT算法的线性调频脉冲压缩 . 电子科技大学学报, 2013, 42(2): 225-228. doi: 10.3969/j.issn.1001-0548.2013.02.009
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[7]	朱永金, 成友才. 应用于语音信号处理的FPGA并行访问设计 . 电子科技大学学报, 2012, 41(1): 158-160. doi: 10.3969/j.issn.1001-0548.2012.01.030
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[9]	马上, 胡剑浩, 叶燕龙. 以{2ⁿ-1,2ⁿ,2ⁿ+1}为基的余数系统2ⁿ高性能缩放 . 电子科技大学学报, 2010, 39(2): 306-310,278. doi: 10.3969/j.issn.1001-0548.2010.02.033
[10]	马涛, 陈杰. 消除重复计算的H.264帧内预测电路 . 电子科技大学学报, 2009, 38(1): 67-70.
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高性能可重构DSP处理器的数据通路设计

1. 中国科学院微电子研究所北京 100029

作者简介:
韩亮(1979-),男,硕士,助理研究员,主要从事数字信号处理,计算体系结构方面的研究.

收稿日期: 2004-03-17
刊出日期: 2005-04-15

中图分类号: TN911

关键词:

摘要: 介绍了高性能定点可重构DSP处理器的数据通路设计。该数据通路以功能强大的16位定点计算单元为基础,搭建起高速16位数据处理平台;并能以单指令流多数据流的方式灵活支持多维向量运算;通过重构的方法有效地支持了32位数据处理。

English Abstract

韩亮, 李莺, 张馨, 陈杰. 高性能可重构DSP处理器的数据通路设计[J]. 电子科技大学学报, 2005, 34(2): 194-197.

引用本文:

韩亮, 李莺, 张馨, 陈杰. 高性能可重构DSP处理器的数据通路设计[J]. 电子科技大学学报, 2005, 34(2): 194-197.

HAN Liang, LI Ying, ZHANG Xin, CHEN Jie. Data Path Design in High Performance Reconfigurable DSP Processor[J]. Journal of University of Electronic Science and Technology of China, 2005, 34(2): 194-197.

Citation:

HAN Liang, LI Ying, ZHANG Xin, CHEN Jie. Data Path Design in High Performance Reconfigurable DSP Processor[J]. Journal of University of Electronic Science and Technology of China, 2005, 34(2): 194-197.

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