Manchester编码器的FPGA设计与实现

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Manchester编码器的FPGA设计与实现

陈新坤, 周东, 余敬东

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陈新坤, 周东, 余敬东. Manchester编码器的FPGA设计与实现[J]. 电子科技大学学报, 2003, 32(3): 324-327.

引用本文:

陈新坤, 周东, 余敬东. Manchester编码器的FPGA设计与实现[J]. 电子科技大学学报, 2003, 32(3): 324-327.

Chen Xinkun, Zhou Dong, Yu Jingdong. Design and FPGA Implementation of Manchester Encoder[J]. Journal of University of Electronic Science and Technology of China, 2003, 32(3): 324-327.

Citation:

Chen Xinkun, Zhou Dong, Yu Jingdong. Design and FPGA Implementation of Manchester Encoder[J]. Journal of University of Electronic Science and Technology of China, 2003, 32(3): 324-327.

Manchester编码器的FPGA设计与实现

1.
电子科技大学宽带光纤传输与通信系统技术国家重点实验室成都 610054

作者简介:
陈新坤男 24岁硕士生主要从事机载数据总线协议芯片设计方面的研究

中图分类号: TN431.2

Design and FPGA Implementation of Manchester Encoder

1.
State Key Laboratory of Broadband Optical Fiber Transmission and Communication Networks,UEST of China Chengdu 610054

摘要: 介绍一种用现场可编程门阵列FPGA实现Manchester编码器的VHDL设计方案,给出了一些重要模块的VHDL源代码。该设计方案已经用QuartusⅡ综合通过,并适配到具体的FPGA器件APEX20KE系列,时序仿真结果与理论相吻合,时序分析表明数据传输率可达22.5 Mb/s。
- 曼彻斯特编码器 /
- 硬件描述语言 /
- 现场可编程门阵列 /
- 综合 /
- 仿真
Abstract: This paper presents a VHDL project of Manchester encoder with FPGA implementation and releases VHDL source code of some important modules. Using QuartusⅡ2.1 of Altera company, the project has been synthesized and fitted to device APEX20KE series with speed. The result of timing simulation is accord with theory. And the timing analysis shows the data rate can be up to 22.5 Mbps.
- Manchester encoder /
- VHDL /
- FPGA /
- synthesis /
- simulation

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[2]	张永亮, 苏涛, 吴边, 周润景. 含有频变耦合系数的交叉耦合滤波器优化设计 . 电子科技大学学报, 2018, 47(4): 516-520. doi: 10.3969/j.issn.1001-0548.2018.04.007
[3]	王瑞, 李乐中, 彭龙, 涂小强, 钟小溪. 星型结多工器综合 . 电子科技大学学报, 2017, 46(4): 525-529. doi: 10.3969/j.issn.1001-0548.2017.04.008
[4]	黄韬, 陈长胜. TTE时间同步协议关键算法研究和仿真分析 . 电子科技大学学报, 2014, 43(3): 437-442. doi: 10.3969/j.issn.1001-0548.2014.03.021
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[7]	于景侠, 贺少勃, 向霞, 袁晓东, 郑万国, 郭袁俊, 祖小涛. 激光辐照熔石英控制的ANSYS仿真 . 电子科技大学学报, 2012, 41(6): 870-874. doi: 10.3969/j.issn.1001-0548.2012.06.010
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Manchester编码器的FPGA设计与实现

1. 电子科技大学宽带光纤传输与通信系统技术国家重点实验室成都 610054

作者简介:
陈新坤男 24岁硕士生主要从事机载数据总线协议芯片设计方面的研究

收稿日期: 2002-12-20
刊出日期: 2003-06-15

中图分类号: TN431.2

关键词:

摘要: 介绍一种用现场可编程门阵列FPGA实现Manchester编码器的VHDL设计方案,给出了一些重要模块的VHDL源代码。该设计方案已经用QuartusⅡ综合通过,并适配到具体的FPGA器件APEX20KE系列,时序仿真结果与理论相吻合,时序分析表明数据传输率可达22.5 Mb/s。

English Abstract

陈新坤, 周东, 余敬东. Manchester编码器的FPGA设计与实现[J]. 电子科技大学学报, 2003, 32(3): 324-327.

引用本文:

陈新坤, 周东, 余敬东. Manchester编码器的FPGA设计与实现[J]. 电子科技大学学报, 2003, 32(3): 324-327.

Chen Xinkun, Zhou Dong, Yu Jingdong. Design and FPGA Implementation of Manchester Encoder[J]. Journal of University of Electronic Science and Technology of China, 2003, 32(3): 324-327.

Citation:

Chen Xinkun, Zhou Dong, Yu Jingdong. Design and FPGA Implementation of Manchester Encoder[J]. Journal of University of Electronic Science and Technology of China, 2003, 32(3): 324-327.

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